DRAM SDRAM DDR2/3/4/5

[bigral]

Привет всем. Решил завести тему про динамическую память. Вот смотрю часто в "корках" используется SDRAM, я то думал что это потому что на самих devboard чаще всего стоит SDRAM (ну а стоит он там изза цены, и цена упала, так как новые устройства проектируют уже под DDR). Но что-то не клеится в этих рассуждениях. В проекте MISTer используют спец плату с SDRAM якобы потому что DDR еще медленее эмулирует произвольный доступ чем SDRAM! Звучит как-то странно. Хотелось бы составить маленькую табличку в которой указать на каких частотах SDRAM, DDR, DDR2, DDR3 могут эмулировать DRAM 150ns, 120ns, 100ns, 80ns (по-моему более быстрая память не применялась в ретро компах, ну скажем для реализации "двух-портовости" может потребоваться максимум 40ns).

[Advertiser]

[Saar]

А что тут странного? у DDR очень большая латентность. Выборка произвольной ячейки очень долгая. Я сейчас не помню точно, но там порядка 20-25 тактов клока требуется чтобы получить данные из ячейки. Ессно, если выбирать серию последовательных ячеек (burst) то скорость будет высокой.
У SDR SDRAM нужно 7-8 циклов клока. Вот и считай что быстрее.
К тому же для DDR используется аппаратный контроллер, где нет контроля цикла рефреша, который может наступить в любой момент - это еще задержка на те же 20-25 циклов. То есть грубо говоря а общем случае порядка 40-50 циклов может уходить на выбор одной произвольной ячейки.
У SDR рефреш можно распределить самому так чтобы он был незаметным - поэтому те же 7-8 циклов сохраняются.
Если для эмулируемой системы точность циклов не важна, то можно заюзать и DDR.

- - - Добавлено - - -

на SDR можно эмулировать частоту DRAM ровно 1/8 скорости SDRAM. то есть при клоке 128MHz можно спокойно иметь скорость выборки эквивалентно SRAM(!) на 16MHz.

- - - Добавлено - - -

на MiSTer стоит DDR3 800MHz. При этом эмулировать ZX Spectrum с точными таймингами невозможно. С SDR SDRAM можно точно сэмулировать даже если SDRAM на 32MHz работает.

[ivagor]

на SDR можно эмулировать частоту DRAM ровно 1/8 скорости SDRAM. то есть при клоке 128MHz можно спокойно иметь скорость выборки эквивалентно SRAM(!) на 16MHz.

Не вполне корректно сравнивать в общем случае SDRAM без учета рефреша со SRAM. Нужно оговорить подразумеваемые ограничения.

- - - Добавлено - - -

На рефреш по минимуму нужно менее процента времени (скорее даже полпроцента). Да, это почти ничто, если есть возможность куда-нибудь "спрятать" рефреш.

[bigral]

К тому же для DDR используется аппаратный контроллер, где нет контроля цикла рефреша, который может наступить в любой момент - это еще задержка на те же 20-25 циклов. То есть грубо говоря а общем случае порядка 40-50 циклов может уходить на выбор одной произвольной ячейки.

Это как я понимаю речь именно про MISTer железо. А можно ли отказаться от использования встроенного железного DDR3 контроллера и заменить его на vhdl реализацию с "равномерным" и "детерменированным" распределением торможения в следствии refresh-a и доступа со стороны arm-a? Ну так чтобы retro core имел гарантированную скорость произвольного доступа.

По сути это привязка всей схемы к clk domain-у ddr контроллера со строго определенными time slots.

А по другому ассинхронному варианту - 800mhz /50 раз задержки = 16mhz... что теоретически говорит о том что "в худшем случае" частота в 16mhz таки достижима.

[shurik-ua]

есть драм память в которой внутри все мультиплексоры и логика для рефреша и наружу видна как статик рам - pseudo-sram
вот тут можно увидеть их цены и характеристики https://www.arrow.com/en/categories/...ry-chips/psram

самая быстрая 36нс - примерно 30Мгц )

[ivagor]

самая быстрая 36нс - примерно 30Мгц )

Неудачный пример и цифры не те. Для произвольного доступа надо смотреть не tACC=36 ns, а то что строчкой пониже, там 56 ns. И это еще без учета рефреша.

[shurik-ua]

да там и напряжения не те - применяется в кнопочных мобилках в основном.

[omercury]

SDRAM, DDR, DDR2, DDR3

Сейчас очень модно отправлять RTFM, но попробую в двух словах буквально на пальцах разобрать технологии.
Кстати, DDRx тоже SDRAM))), то есть (Synchronous)Синхронная с (Dynamic)Переменным (Random)Произвольным (Access)Доступом (Memory)Память.
Смысл переменного доступа в (а)переменной длине считвываемого/записываемого потока данных и (б) переменной последовательности слов данных.
Все процессы в обычной SDRAM (3,3v) синхронизированы с положительным перепадом на тактовом входе.
Память типов DDRx (Double Data Rate) отличается от обычной SDRAM тем, что данные читаются/записываются как по положительному, так и по отрицательному перепаду на тактовом входе. На самом деле у DDR дифференциальный вход такта, но для простоты восприятия лучше ИМХО учитывать прямой вход тактовой, на инверсном такт просто противофазный.
DDR разных видов отличаются между собой количеством считываемых/записываемых слов (в данном случае это не uint_16t, а количество пинов внешней шины данных), что достигается удвоенной/учетверённой/увосьмерённой шириной внутренней шины данных.
В DDR первого поколения по одному адресу читается 2 слова, в DDR-II - 4 слова, а в DDR-III - 8 слов последовательно. И считать их нужно обязательно все... Плюс всё это ещё умножается на длину бюрста. Всё это легко увидеть, рассматривая структурные схемы в документации на соответствующие типы памяти.

на MiSTer стоит DDR3 800MHz

Чистейшей воды маркетинг.
На самом деле память работает на тактовой всего лишь 100-200МГц. 800 - эквивалентная пропускная способность, то есть столько было бы, если бы вся внутренняя шина данных была бы выведена наружу. )))
100МГц*8=800. 8 - отношение ширин внутренней к внешней шин данных.

Ну а дальше всё ещё веселей - латентность (задержка). Обозначается как CL - Cas Latency.
Этим понятием указывается количество циклов тактовой с момента подачи сигналов на пины чипа до того момента, как внутри что-то там переключится.
"Обычная" SDRAM имеет от 1(старые чипы) до 3 тактов CL, в DDR тактов стало намного больше - в DDR от 5 и чем больше цифра после DDR, тем их всё больше и больше. Потому, что сама структура схемы управления массивом памяти становится всё сложнее и сложнее, цепочки управляющих сигналов удлинняются, а задержки в кристалле меньше "почему-то" не становятся... Технологический предел.

А по другому ассинхронному варианту - 800mhz /50 раз задержки = 16mhz... что теоретически говорит о том что "в худшем случае" частота в 16mhz таки достижима.

100MHz/(6+6+6+4,5)=4,44. Не считая рефреша.
Увы...

- - - Добавлено - - -

Не вполне корректно сравнивать в общем случае SDRAM без учета рефреша со SRAM. Нужно оговорить подразумеваемые ограничения.

- - - Добавлено - - -

На рефреш по минимуму нужно менее процента времени (скорее даже полпроцента). Да, это почти ничто, если есть возможность куда-нибудь "спрятать" рефреш.

А это зависит от того, насколько Вы готовы усложнить контроллер SDRAM.
Например во время обратного хода луча (СГИ - 12,5% времени), память отображалке экрана совершенно не нужна.
А ведь есть ещё и КГИ.

[CodeMaster]

Смысл переменного доступа в (а)переменной длине считвываемого/записываемого потока данных

Т.е. сейчас Dynamic означает не то, что раньше (изготовление ячеек на основе конденсаторов и необходимость рефреша)?

На самом деле память работает на тактовой всего лишь 100-200МГц. 800 - эквивалентная пропускная способность, то есть столько было бы, если бы вся внутренняя шина данных была бы выведена наружу. )))

Что значит "столько было бы"? Оно столько и есть (пропускная способность), но да не в произвольном доступе.
И проблема не в соотношении ширин шин, а в том что для одного байта вся эта пропускная способность ничего не даёт и память работает на той же физической частоте, но с всё бОльшими задержками между операциями доступа.

[andreil]

Сейчас очень модно отправлять RTFM, но попробую в двух словах буквально на пальцах разобрать технологии.

Кстати да, даже SDRAM очень медленная для таких целей и приходится использовать на максимальных частотах. В своём проекте думал использовать набортный чип для организации памяти (и в последующем - и в реале). По факту, для тактовой частоты Z80 в 12МГц память пришлось тактировать на все 130МГц, что бы она всё-всё успевала и не приходилось тормозить ЦП. А это для реала - уже убийство, иметь такую частоту на плате...

- - - Добавлено - - -

Т.е. сейчас Dynamic означает не то, что раньше (изготовление ячеек на основе конденсаторов и необходимость рефреша)?

То же, только между самой памятью как таковой и ПК появилась своя логика, которая находится в каждом чипе и управляет им. Эта логика занята циклами рефреша и собственно организацией доступа к памяти. Вот эта-то логика и требует тактирования и циклов работы.